ESP32-S3后量子密码工程：Xtensa架构评测与栈优化

1. 引言与物联网后量子密码工程化挑战

在量子计算理论与工程实现飞速演进的时代背景下，基于大整数分解难题与椭圆曲线离散对数难解性假设的传统公钥密码体系（包括 RSA、ECDSA、ECDH 以及我国现行的国密 SM2 算法）面临着 Shor 量子多项式时间算法带来的确定性破解威胁。为此，美国国家标准与技术研究院（NIST）于 2024 年 8 月正式发布了首批后量子公钥密码标准，即基于模块格上带误差学习（MLWE）问题的密钥封装标准 FIPS 203（ML-KEM）、基于模块格短整数解（MSIS/MLWE）问题的数字签名标准 FIPS 204（ML-DSA）以及基于无状态哈希树的数字签名标准 FIPS 205（SLH-DSA）。与此同步，中国密码学会（CACR）后量子密码评选与中国商用密码后量子标准演进亦在加速推进，Aigis-enc 与 SCloud+ 等代表性算法展现了深厚的数学底蕴与安全保障。

然而，从理论算法规范到真实物理世界中的微控制器（MCU）与边缘物联网（IoT）设备部署，存在着巨大的工程落地鸿沟。在资源极度受限的微控制器环境中，系统往往面临极其严苛的物理约束：

1. 静态随机存取内存（SRAM）极度紧缺：大多数主流物联网 MCU 的内部静态 SRAM 仅有数百千字节（例如 ESP32-S3 的内部 SRAM 仅为 512KB），而格密码算法的大尺寸多项式矩阵运算、高斯分布与居中二项分布采样极易耗尽局部调用栈空间；
2. 计算核心算力与指令集限制：低功耗嵌入式处理器的主频通常在数十至数百兆赫兹之间，缺乏通用服务器平台上的先进矢量扩展（如 x86 AVX-512 或 ARM SVE2），格密码的数论变换（NTT）与 Keccak 状态置换（SHAKE-128/256）对时钟周期消耗极为敏感，容易导致通信协议超时；
3. 实时操作系统（RTOS）并发与看门狗约束：在基于 FreeRTOS 等嵌入式实时操作系统的设备中，长时间独占 CPU 的密码计算会导致同核心上的空闲任务发生饥饿，进而触发任务看门狗定时器（Task-WDT）硬复位，引发系统异常重启；
4. 多算法混合环境下的符号冲突与链接污染：嵌入式交叉编译工具链通常采用扁平的全局符号命名空间，不同算法参考实现之间重名的基础数学函数与打包接口极易引发符号重复定义错误；
5. 硬件物理熵源接入的可靠性断层：开源 PQC 参考实现默认依赖 POSIX /dev/urandom 字符设备，在裸机或嵌入式虚拟文件系统（VFS）上直接引发系统空指针解引用或 abort 崩溃。

乐鑫科技（Espressif Systems）推出的 ESP32-S3 芯片作为当前工业物联网、智能电网采集终端与智能边缘控制领域被广泛采用的高性能 SoC，集成了双核 32 位 Xtensa LX7 处理器，主频高达 240MHz，并引入了专用于加速神经网络与向量计算的 PIE（Processor Interface Extension）128 位单指令多数据（SIMD）扩展指令集。本篇工程技术报告基于正微光电与母公司正则量子在嵌入式后量子密码领域的工程研发积累，针对 ESP32-S3 物理实机（QFN56 rev v0.2，MAC 98:c3:77:b5:32:30，配置 512KB 内部 SRAM 与 8MB Octal PSRAM）开展了深度适配、编译优化、内存栈重构与全维度性能压测。

本文将彻底公开在 ESP32-S3 真实物理芯片上运行 FIPS 203 ML-KEM-512、FIPS 204 ML-DSA-44、FIPS 205 SLH-DSA SHA2-128s 以及国密 PQC 算法 Aigis-enc Mode 1 和 SCloud+ 128 的第一手基准评测数据，详细复盘从栈溢出调试、命名空间隔离、流式矩阵展开到硬件真随机数（TRNG）注入的完整工程闭环。

2. ESP32-S3 硬件微架构与后量子密码加速拓扑

要实现后量子密码算法在嵌入式端的高效执行，必须深入理解目标处理器的底层微架构特征与片上存储互连拓扑。ESP32-S3 搭载了两颗由 Tensilica 设计的 32 位 Xtensa LX7 处理核心（Core 0 与 Core 1），其微架构针对数字信号处理与密集矩阵运算进行了深度定制。

2.1 Xtensa LX7 核心流水线与 PIE 矢量扩展

Xtensa LX7 采用典型的 7 级流水线设计（取指、译码、寄存器读、执行/地址生成、数据缓存访问、写回），支持双发射（Dual-Issue）超标量执行机制。在通用算术逻辑单元（ALU）之外，ESP32-S3 集成了 128 位的 PIE（Processor Interface Extension）向量指令集：

• 向量寄存器堆：提供 16 组 128 位的专用向量寄存器（q0 ~ q15），可配置为 16 个 8 位、8 个 16 位或 4 个 32 位的并行数据通道；
• 并行乘加单元（MAC）：支持单周期完成 4 组 32 位整数乘加操作或 8 组 16 位整数乘加操作。对于后量子格密码中的多项式点乘、蒙哥马利模约简（Montgomery Reduction）以及蝶形变换提供了强大的硬件算力基础；
• 通用寄存器堆与窗口机制：包含 32 个 32 位通用物理寄存器（ar0 ~ ar31），支持基于滑动窗口机制的寄存器窗口旋转（Windowed Register Call），通过 ENTRY 与 RETW 指令自动完成调用帧切换，极大降低了深度函数调用时的入栈与出栈开销；
• 专用向量加载与存储指令：提供 ee.vld.128.ip 与 ee.vst.128.ip 指令，支持在单个时钟周期内从内存加载 128 位向量并自动递增基址指针，为数论变换（NTT）的连续多项式系数遍历提供了极高的数据吞吐率。

2.2 片上多级存储层次与总线互连

ESP32-S3 的片上存储子系统设计直接决定了格密码大尺寸工作集的加载与缓存命中效率：

1. 内部低延迟 SRAM（512KB）：划分为 4 个独立的存储器 Bank（Bank 0 ~ 3），通过高带宽交叉开关总线（Crossbar Interconnect）与双核 CPU 互连。多 Bank 并联架构支持两个核心同时并发访问不同地址区间，且支持 DMA 控制器进行零等待的后台数据传输。单周期无等待（Zero-Wait-State）特性使其成为执行高频多项式模乘与模加减的理想空间；
2. 外部高速八线 PSRAM（8MB Octal SPI, OPI）：通过 80MHz/120MHz 的 OPI 总线挂载，配合内部 32KB 的高速两级 Cache 机制。尽管 PSRAM 提供了充裕的存储容量，但由于 SPI 串行总线时延与 Cache 缺失惩罚（Cache Miss Penalty，实测单次未命中需承受 20 至 40 个 CPU 时钟周期的停顿），其连续随机访问延迟显著高于内部 SRAM。因此，在算法实现中必须确保关键的蝶形变换、矩阵乘法与私钥敏感运算严格驻留在内部 SRAM 中，仅将大尺寸证书链与 OTA 固件缓存置于 PSRAM；
3. 通用直接内存访问控制器（GDMA）：GDMA 控制器拥有独立的 AXI 总线主控权，能够在无需 CPU 干预的情况下，将外设数据（如 Wi-Fi/以太网报文、UART 流）直接搬运至指定的 SRAM 环形缓冲区，有效消除了通信与密码计算之间的数据拷贝等待。

2.3 片上安全硬件外设与物理真随机数

ESP32-S3 片上集成了多项硬件安全加速外设：

• 硬件对称加密与哈希协处理器：包含硬件 AES-128/256 加解密引擎、硬件 SHA-1/SHA-256 哈希加速器以及 RSA-3072/4096 大数模乘加速器。在 SLH-DSA-SHA2-128s 签名验证中，片上硬件 SHA 协处理器可用于卸载外层消息摘要计算；
• 物理真随机数发生器（TRNG）：基于片上内部 Wi-Fi 与蓝牙射频收发链路的热噪声，通过逐次逼近寄存器型模数转换器（SAR ADC）进行高速采样与内部去偏，在射频使能状态下能够源源不断地输出符合物理随机性统计特性的真随机比特流，为后量子密钥生成提供不可预测的物理熵源注入。

3. 双核编译环境下的符号隔离与全局命名空间重构

在将多个 PQC 算法（包括不同参数集的 ML-KEM、ML-DSA、SLH-DSA 以及国密算法）集成至基于 ESP-IDF 构建的单一固件工程时，我们遭遇的第一个致命阻碍是编译工具链的全局符号命名空间冲突。

3.1 跨组件符号冲突机理与排查

ESP-IDF（本实验采用 v5.4.4，搭配 xtensa-esp32s3-elf-gcc 14.2.0）构建系统将各个组件（Components）编译为静态归档库（.a 文件），并在最终链接阶段将所有对象文件合并至一个扁平的全局命名空间。在开源社区中，诸如 PQClean、liboqs 以及各类独立算法参考实现往往使用通用的内部函数命名。

在首次全量交叉编译时，链接器报出了 10 组严重的重复定义（multiple definition of symbol）硬错误：

3.2 自动化宏封装与符号隔离工程实现

为了彻底消除符号污染且不破坏各算法内部代码的可维护性，我们在各组件的核心参数头文件（如 params.h、indcpa.h、ntt.h）中构建了严密的双层宏替换机制：

/* pqc_dilithium2/params.h 命名空间隔离实现 */
#ifndef PARAMS_H
#define PARAMS_H

#define DILITHIUM_NAMESPACE(s) hyq_mldsa44_##s

#define ntt DILITHIUM_NAMESPACE(ntt)
#define invntt_tomont DILITHIUM_NAMESPACE(invntt_tomont)
#define poly_reduce DILITHIUM_NAMESPACE(poly_reduce)
#define pack_pk DILITHIUM_NAMESPACE(pack_pk)
#define pack_sk DILITHIUM_NAMESPACE(pack_sk)
#define pack_sig DILITHIUM_NAMESPACE(pack_sig)
#define unpack_sig DILITHIUM_NAMESPACE(unpack_sig)

#endif /* PARAMS_H */

在 Kyber 组件中，我们补齐了此前遗漏的打包函数宏定义：

/* pqc_kyber512/indcpa.h 补齐命名空间 */
#define pack_pk KYBER_NAMESPACE(pack_pk)
#define pack_sk KYBER_NAMESPACE(pack_sk)
#define pack_ciphertext KYBER_NAMESPACE(pack_ciphertext)

在国密算法 Aigis-enc 中，针对其错误的恒等宏定义进行了精准纠正，将 GLOBAL_NAMESPACE(s) 重新映射至专属命名空间 AIGIS_ENC_NAMESPACE(s)。

通过在编译构建脚本中加入符号提取断言（nm -g libpqc_*.a | awk '{print $3}' | sort | uniq -d），构建流水线能够实时检测任何潜在的全局符号冲突，确保最终二进制产物中实现 0 符号碰撞。

4. ML-KEM-512 在 Xtensa LX7 上的原位模算术实现与评测

ML-KEM（原 CRYSTALS-Kyber）在 NIST FIPS 203 中被确立为通用的后量子密钥封装机制标准。ML-KEM-512 对应 NIST 安全等级 1（等效于 AES-128），其核心数学运算定义在多项式商环 $R_q = \mathbb{Z}_q[X]/(X^n + 1)$ 上，其中多项式次数 $n = 256$，模数 $q = 3329$。由于模数 $q$ 满足素数条件 $q \equiv 1 \pmod{2n}$（$3329 = 13 imes 256 + 1$），环 $R_q$ 中存在本原 256 次代数单位根 $\zeta = 17$，允许直接应用全分解的快速数论变换（NTT）。

4.1 数学原理与蝶形变换优化

在 ML-KEM-512 中，公钥包含多项式矩阵 $\mathbf{A} \in R_q^{2 imes 2}$ 与多项式向量 $\mathbf{t} = \mathbf{A}\mathbf{s} + \mathbf{e}$。加密过程通过计算 $\mathbf{u} = \mathbf{A}^T\mathbf{r} + \mathbf{e}_1$ 与 $v = \mathbf{t}^T\mathbf{r} + e_2 + \lceil q/2 floor \cdot m$ 实现明文信息 $m \in \{0,1\}^{256}$ 的封装。

在多项式乘法中，若采用朴素的学校乘法（Schoolbook Multiplication），计算复杂度为 $O(n^2) = 65536$ 次模乘操作。通过 NTT 将多项式转换至频域表示，乘法复杂度骤降至 $O(n \log n) = 256 imes 8 = 2048$ 次模乘。

在 Xtensa LX7 上，NTT 的正向变换采用 Cooley-Tukey 蝶形算子，其递推公式为：

egin{cases} a_j' = a_j + \zeta \cdot a_{j+len} \pmod q \ a_{j+len}' = a_j - \zeta \cdot a_{j+len} \pmod q \end{cases}

逆数论变换（INTT）则采用 Gentleman-Sande 蝶形算子：

egin{cases} a_j' = a_j + a_{j+len} \pmod q \ a_{j+len}' = (a_j - a_{j+len}) \cdot \zeta^{-1} \pmod q \end{cases}

为了在 240MHz 的 Xtensa LX7 上榨取极致算力，我们对原位 NTT 实现了多级流水编排：

1. 蒙哥马利域预计算与常数驻留：将 128 个本原根旋转因子 $\zeta^{\mathrm{brv}(i)}$ 预先乘以常数 $R = 2^{16} \pmod q = 2285$，存放在 16 位对齐的只读数据段（.rodata）中；
2. 蒙哥马利约简汇编级调度：对于中间乘积 $c = a \cdot b$，其蒙哥马利约简数学推导如下。设基数 $R = 2^{16}$，模数 $q = 3329$，满足 $\gcd(R, q) = 1$。预先计算常数 $q^{-1} \equiv -q^{-1} \equiv 62209 \pmod R$。约简流程计算商数 $t \equiv c \cdot q^{-1} \pmod R$，随后计算高位差分：

r = rac{c - t \cdot q}{R}

由于 $c - t \cdot q \equiv c - (c \cdot q^{-1} \cdot q) \equiv 0 \pmod R$，差分结果必能被 $R = 2^{16}$ 整除。在 Xtensa 汇编中，直接提取 32 位乘法器的高 16 位结果即可完成除法，完全消除了昂贵的除法指令周期； 3. PIE SIMD 向量化展开：利用 128 位向量指令，一条指令同时加载 8 个 16 位系数，并行执行两组 4 路蝶形模乘与模加减； 4. 原位寄存器复写（In-Place Writeback）：整个 7 级 NTT 迭代过程直接在多项式自身的 512 字节连续内存块中完成，无需开辟额外的中间转存缓冲区。

4.2 抗侧信道 FO 变换与隐式拒绝机制

FIPS 203 要求使用 Fujisaki-Okamoto（FO）变换将不可辨别选择明文安全（IND-CPA）的公钥加密方案转换为抗选择密文攻击（IND-CCA2）安全的密钥封装机制。在解封装操作 crypto_kem_dec() 中，系统通过私钥还原明文 $m' = \mathrm{Decrypt}(\mathbf{s}, \mathbf{c})$，并重新调用加密算法生成比对密文 $\mathbf{c}' = \mathrm{Encrypt}(\mathbf{pk}, m', r')$。

在经典的公钥解密流程中，若发现解密后的明文重加密结果与输入密文不匹配，传统实现通常会直接向上层应用返回错误码（如 CRYPTO_ERR_DECRYPTION_FAILED）。然而在后量子密码环境中，这种显式报错会构成极其危险的定时与故障预言机（Oracle），攻击者可通过精心构造畸变密文并观测错误返回时间，逐步推导私钥格向量的几何倾角。

因此，FIPS 203 强制推行了严格的隐式拒绝（Implicit Rejection）机制：即使重加密校验失败，底层算法也绝不向上层抛出任何异常分支，而是基于预置在私钥中的随机伪密钥种子 $z \in \{0,1\}^{256}$，通过哈希派生出一个看似合法但完全不可预测的伪共享密钥（Pseudorandom Shared Secret）。

为防御物理功耗侧信道（DPA）与计时侧信道攻击，解封装比对过程必须采用常数时间比较算法：

/* 常数时间密文比对与隐式拒绝伪代码 */
int diff = 0;
for (size_t i = 0; i < KYBER_CIPHERTEXTBYTES; i++) {
    diff |= (c[i] ^ c_prime[i]);
}
/* 利用符号位扩展生成掩码: diff == 0 时 mask = 0x00, 否则 mask = 0xFF */
uint8_t mask = (uint8_t)((-(int32_t)(uint32_t)diff) >> 31);

/* 若比对失败，输出基于伪随机预置私钥派生的伪共享密钥，而非显式报错 */
for (size_t i = 0; i < KYBER_SSBYTES; i++) {
    shared_secret[i] = (true_ss[i] & ~mask) | (fake_ss[i] & mask);
}

4.3 物理实机性能实测

在 ESP32-S3 实机上，以 240MHz 主频运行 1000 轮独立基准测试，统计平均执行耗时与系统吞吐量如下：

测试结果显示，ML-KEM-512 在 ESP32-S3 上单次密钥交换全流程（KeyGen + Encaps + Decaps）耗时仅为 13.57ms。两端派生出的共享主密钥达成 100% 比对一致（shared secret 100% MATCH），完全满足工业网关与智能配电终端毫秒级快速握手的严苛时延要求。

5. ML-DSA-44 栈溢出机理剖析与流式矩阵展开优化

FIPS 204 标准化的 ML-DSA（原 CRYSTALS-Dilithium）是当前后量子数字签名的基石算法。ML-DSA-44 作为安全等级 2 的标准参数集，其代数结构基于模数 $q = 8380417 = 2^{23} - 2^{13} + 1$，多项式矩阵维度为 $k imes l = 4 imes 4$。尽管其数学结构高度精妙，但在嵌入式系统中直接移植官方参考实现时，却暴露出灾难性的栈内存膨胀缺陷。

5.1 栈溢出深层根因与 Core 1 诡异崩盘复盘

在将未经内存重构的 ML-DSA-44 签名算法烧录至 ESP32-S3 后，系统在首次执行密钥生成 crypto_sign_keypair() 或签名 crypto_sign_signature() 时发生静默崩溃。串口终端输出如下异常寄存器快照：

Guru Meditation Error: Core 1 panic'ed (LoadProhibited). Exception was unhandled.
Core 1 register dump:
PC      : 0x42008df4  PS      : 0x00060030  A0      : 0x82009120  A1      : 0x3fc97000
A2      : 0x3fc98240  A3      : 0x00000000  A4      : 0x3fc99000  A5      : 0x00000800
EXCVADDR: 0x3fc96ffc  LBEG    : 0x40056f5c  LEND    : 0x40056f71  LCOUNT  : 0x00000000
Backtrace: 0x42008df4:0x3fc97000 0x4200911d:0x3fc97050 0x420076a8:0x3fc970a0

更具迷惑性的是，在部分测试用例中，异常并未直接在密码运算函数内部抛出，而是在系统运行数秒后，于 Core 1 的空闲任务（IDLE1）或任务看门狗中断处理例程 中抛出 InstrFetchProhibited，崩溃调用栈中完全没有出现任何密码算法符号。

为了彻底定位崩溃机理，我们在主任务中引入 FreeRTOS 栈高水位度量探针 uxTaskGetStackHighWaterMark(NULL)，对各阶段的真实内存开销进行实时捕获：

[STACK MONITOR] Free stack at task entry      : 116 760 Bytes (Initial: 131 072 Bytes)
[STACK MONITOR] Free stack after Dilithium KeyGen: 100 072 Bytes (Peak consumed: 30 992 Bytes)
[STACK MONITOR] Free stack after Dilithium Sign  :  86 120 Bytes (Peak consumed: 44 952 Bytes)

深层根因剖析：

1. 多项式矩阵的全量栈分配：在 ML-DSA-44 官方参考实现中，为了加速矩阵与向量乘法，函数内部声明了局部多项式矩阵 polyvecl mat[4]。每个多项式包含 256 个 32 位系数（占据 1024 字节），一个 polyvecl 包含 4 个多项式（4096 字节），矩阵 mat[4] 仅单项就霸占了 $4 imes 4096 = 16384$ 字节（16KB）的栈空间；
2. 多重向量级联声明：在签名函数 crypto_sign_signature() 中，除了矩阵 mat 外，算法还同时声明了掩码向量 $\mathbf{y}$（4KB）、秘密向量 $\mathbf{s}_1, \mathbf{s}_2$（8KB）、中间向量 $\mathbf{w}_1, \mathbf{w}_0$（8KB）、签名响应向量 $\mathbf{z}$（4KB）以及提示向量 $\mathbf{h}$（4KB）。所有局部变量累计在栈上形成了超过 44KB 的瞬时栈内存峰值；
3. FreeRTOS 默认栈边界击穿：ESP-IDF 默认分配给应用程序主任务的栈空间仅为 3.5KB 至 32KB（CONFIG_ESP_MAIN_TASK_STACK_SIZE=32768）。44KB 的瞬时申请直接击穿了任务栈底，覆盖了相邻任务控制块（TCB）与 FreeRTOS 堆元数据；
4. 栈金丝雀（Stack Canary）失效机制：由于密码计算为单核密集循环执行且未主动让出 CPU，FreeRTOS 的上下文切换检测逻辑未能及时触发，直到任务尝试访问非法指针或看门狗例程调度时才引发硬件异常中断。

5.2 原位流式矩阵展开（Streaming ExpandA）设计

为了将 ML-DSA-44 的栈内存开销从不可接受的 44KB 压缩至微控制器友好的极限水平，我们重构了矩阵生成与乘法计算管线，提出了原位流式矩阵展开与累加架构（On-The-Fly Streaming Matrix Expansion）。

其核心思想在于：公钥种子 $ho$ 展开出的矩阵 $\mathbf{A} \in R_q^{4 imes 4}$ 具有高度的确定性与伪随机独立性。在计算 $\mathbf{w} = \mathbf{A}\mathbf{y}$ 时，无需预先将整个 $4 imes 4$ 矩阵全量缓存在 RAM 中，而是采用逐行（Row-by-Row）生成并立即执行多项式乘累加策略：

$$\mathbf{w}_i = \sum_{j=0}^{l-1} a_{i,j} \cdot \mathbf{y}_j = \sum_{j=0}^{l-1} \mathrm{SHAKE128}( ho \parallel i \parallel j) \otimes \mathbf{y}_j \pmod q$$

/* 原位流式矩阵展开与原位乘累加工程实现 */
void mldsa44_streaming_matrix_pointwise(polyveck *w, const uint8_t rho[SEEDBYTES], const polyvecl *y_ntt) {
    poly a_elem; // 仅开辟单个多项式临时缓冲（1024 字节）
    
    for (uint8_t i = 0; i < K; i++) {
        poly_zero(&w->vec[i]);
        for (uint8_t j = 0; j < L; j++) {
            // 1. 流式从种子 rho 派生单个矩阵元素 a[i][j]
            poly_uniform(&a_elem, rho, (uint16_t)((i << 8) | j));
            
            // 2. 频域点乘并原位累加至目标行 w[i]
            poly_pointwise_montgomery_acc(&w->vec[i], &a_elem, &y_ntt->vec[j]);
        }
        // 3. 执行逆数论变换还原至时域
        poly_invntt_tomont(&w->vec[i]);
    }
}

通过这一重构：

• 彻底消除了 polyvecl mat[4] 占据的 16KB 静态栈开销；
• 矩阵生成缓冲区由 16384 字节急剧缩减至单多项式 1024 字节，内存复用率提升 16 倍；
• 整体签名算法的栈高水位峰值成功从 44 952 字节 降至 8 416 字节。配合将 CONFIG_ESP_MAIN_TASK_STACK_SIZE 安全配置为 131072（131KB），在全流程运行中始终保留了超过 86KB 的绝对安全余量。

5.3 拒绝采样状态机与实机评测

ML-DSA 签名基于“带中止的 Fiat-Shamir”（Fiat-Shamir with Aborts）框架。在每一轮签名循环中，算法从掩码分布中抽取多项式向量 $\mathbf{y} \in S_{\gamma_1}^l$，计算 $\mathbf{w}_1 = \mathrm{HighBits}(\mathbf{A}\mathbf{y}, 2\gamma_2)$，并由消息摘要 $M$ 与 $\mathbf{w}_1$ 派生挑战多项式 $c \in R_q$。随后计算候选响应向量：

$$\mathbf{z} = \mathbf{y} + c \cdot \mathbf{s}_1$$

算法必须严格执行三项常数时间拒绝采样判决：

1. 响应范数检查：\Vert \mathbf{z} \Vert_\infty \ge \gamma_1 - eta（ML-DSA-44 中 \gamma_1 = 2^{17}, eta = 78），若超界则拒绝当前签名，无条件重跳回第 1 步重新采样 $\mathbf{y}$；
2. 低位误差泄露检查：计算 $\mathbf{r}_0 = \mathrm{LowBits}(\mathbf{A}\mathbf{y} - c\mathbf{s}_2, 2\gamma_2)$，若 \Vert \mathbf{r}_0 \Vert_\infty \ge \gamma_2 - eta 则中止重试；
3. 提示向量稀疏性检查：计算提示向量 $\mathbf{h} = \mathrm{MakeHint}(-\mathbf{c}\mathbf{s}_2, \mathbf{w} - c\mathbf{s}_2 + c\mathbf{s}_2, 2\gamma_2)$，若 $\mathbf{h}$ 中 1 的权重大于阈值 $\omega = 80$ 则中止重试。

在 ESP32-S3 硬件实机上的测试数据显示：

工程观察：ML-DSA 签名耗时在 38ms 至 70ms 之间波动，这是由拒绝采样固有的几何分布决定的（平均需要 2.5 至 4 次循环才能命中一组完全满足范数约束的签名向量），而非系统时钟抖动。签名验证（Verify）耗时恒定在 15.2ms 左右，100% 通过已知答案测试（signature VERIFIED 100%）。

6. SLH-DSA-128s 紧凑流式验签与看门狗防饥饿调度

NIST FIPS 205 标准化的 SLH-DSA（原 SPHINCS+）是完全基于哈希函数安全性假设的无状态数字签名算法。与基于格难解性问题的方案不同，SLH-DSA 的安全性仅依赖于 underlying 哈希函数（如 SHA-256 或 SHAKE-256）的抗碰撞性与单向性，被公认为抵抗量子计算威胁的最坚固防线。然而，其代价是极度庞大的计算调用图与相对较长的签名生成时间。

6.1 裸机运行环境下的 RBG 回调空指针缺陷修复

在 ESP32-S3 上移植 SLH-DSA 官方库时，我们捕获到一个仅在嵌入式裸机环境下复现的严重缺陷：调用密钥生成函数 crypto_sign_keypair() 时，程序直接跳转至绝对零地址执行，导致 CPU 产生 InstrFetchProhibited (EXCVADDR: 0x00000000) 致命异常。

反汇编深度溯源： 在 slh_dsa.c 的第 505 行中，密钥生成逻辑无条件调用了结构体中的随机比特发生器函数指针 ctx->rbg(buf, len)。在通用 Linux/Windows 环境中，该指针由上层应用初始化为指向系统的 CSPRNG；但在嵌入式精简测试框架中，调用方传递了 NULL 参数。由于代码中缺少防御性判空检查，CPU 直接将 0x00000000 装入程序计数器（PC）并触发硬件捕获。

修复方案： 我们在底层适配层构建了类型安全的随机数注入适配器，动态绑定至 ESP32-S3 的物理硬件熵源函数：

/* SLH-DSA 嵌入式适配层与空指针保护 */
static int esp32_pqc_rbg_adapter(void *dest, size_t size) {
    if (!dest) return -1;
    randombytes((uint8_t *)dest, size); // 绑定至 esp_fill_random
    return 0;
}

int hyq_slhdsa_keygen_safe(uint8_t *pk, uint8_t *sk) {
    slh_ctx_t ctx;
    ctx.rbg = esp32_pqc_rbg_adapter; // 强制注入安全回调，杜绝 NULL 跳转
    return slh_keygen_internal(&ctx, pk, sk);
}

值得注意的是，SLH-DSA 的签名函数 slh_sign() 允许将可选随机熵指针 addrnd 显式设为 NULL，此时算法会自动遵循标准规定，使用私钥派生的伪随机确定性模式进行签名（Deterministic Mode），两者在架构设计上存在明确的语义区分。

6.2 64KB 固件流式分块验签架构

在物联网固件安全空中升级（OTA）场景中，微控制器需要频繁对接收到的 64KB 至数兆字节的二进制固件进行数字签名校验。若将整个固件镜像全部缓存进 SRAM，将直接耗尽系统可用内存。

针对 SLH-DSA SHA2-128s（参数配置：树高 $h=63$，超树层数 $d=7$，FORS 树高 $a=12$，FORS 树棵数 $k=33$），我们设计了流式分块哈希验签流水线：

1. 分块流式摘要计算：利用片上硬件 SHA-256 引擎，以 1KB 环形缓冲区为粒度逐块读取 Flash 中的固件镜像，完成消息摘要 $H_{\mathrm{msg}}$ 的计算；
2. FORS 认证树叶子解析：从签名数据中提取 33 组 FORS 认证路径，逐一重构出 $k=33$ 个 FORS 树根节点，并压缩生成 32 字节的 FORS 顶层公钥 $\mathrm{PK}_{\mathrm{fors}}$；
3. $d=7$ 层 XMSS 超树折叠：沿着超树自底向上逐层执行 WOTS+ 一次性签名验证与树节点哈希迭代，最终还原出根节点哈希值，并与内置公钥 PK.root 进行常数时间匹配。

在 240MHz 的 ESP32-S3 实机上，对 64KB 固件载荷执行 SLH-DSA-SHA2-128s 完整流式验签，耗时仅为 51 952 µs（51.95 ms），验证吞吐达到 19.2 次/秒。这一实测数据证明，尽管 SLH-DSA 的签名计算开销巨大，但其验签性能完全足以胜任物联网安全启动与固件完整性度量需求。

6.3 36秒密集签名与 FreeRTOS Task-WDT 防饥饿协作

SLH-DSA-128s 在 240MHz 核心上的签名生成需要遍历超树中数以万计的哈希链计算，实机测试耗时达到 36 411 362 µs（约 36.41 秒）。

在 FreeRTOS 环境下，默认使能的任务看门狗（Task-WDT）具有 5 秒超时阈值。如果签名任务在 Core 0 或 Core 1 上持续进行死循环计算而不主动出让控制权，同核心上的空闲任务（IDLE0/IDLE1）将无法获得调度机会来“喂狗”，从而在运行 5 秒后触发系统级看门狗硬复位：

Task watchdog got triggered. The following tasks did not reset the watchdog in time:
 - IDLE0 (CPU 0)
Tasks currently running:
 - main (CPU 0)

防饥饿协同调度方案： 在生产环境中，严禁直接通过全局禁用 Task-WDT 来规避报错。正确的工程实践是将 SLH-DSA 签名运算封装为独立的低优先级后台 Worker 任务，并在 XMSS 树的每层迭代（$d$ 循环）中主动插入显式的协作让出原语：

/* SLH-DSA 多任务防饥饿调度工程实现 */
for (int tree_level = 0; tree_level < SPX_D; tree_level++) {
    // 执行单层 XMSS 树节点哈希与签名计算
    treehash_level_compute(ctx, tree_level, ...);
    
    // 每完成一层计算，主动让出 1 个 FreeRTOS Tick（10ms），驱动空闲任务喂狗
    vTaskDelay(pdMS_TO_TICKS(10));
}

通过将计算过程细粒度切片化，系统在执行长达数十秒的复杂后量子签名计算的同时，仍能保持网络报文响应与系统看门狗心跳的正常运转。

7. 国密 PQC 算法 Aigis-enc 与 SCloud+ 物理实测对比

在中国密码学会（CACR）后量子密码评选与技术演进中，多款具备自主知识产权的格密码算法崭露头角。在本轮 ESP32-S3 实机工程测试中，我们同步集成了两款极具代表性的国产候选方案：基于模块格带误差学习问题的 Aigis-enc（Mode 1） 以及基于非结构化格（Standard LWE）的轻量级方案 SCloud+ 128。

7.1 五大后量子算法全维度性能横向矩阵

我们在完全相同的 ESP32-S3 硬件环境（Xtensa LX7 @ 240MHz，ESP-IDF v5.4.4，-O3 编译优化）下，对 5 款代表性 PQC 算法进行了统一压测，实测数据汇总如下表所示：

7.2 SCloud+ 在微控制器上的性能瓶颈根因剖析

从实测数据中可以清晰看出，SCloud+ 128 的执行耗时约为 ML-KEM-512 的 90 至 100 倍。造成这一巨大性能悬殊的核心根因在于其代数假设与硬件支持的错配：

1. 非结构化格的巨大矩阵维度：SCloud+ 为了规避代数环结构可能存在的潜在代数弱点，采用了标准非结构化 LWE 假设。这导致其公钥尺寸高达 7 216 字节，私钥尺寸高达 8 480 字节（约为 ML-KEM-512 的 9 倍与 5 倍），无法应用高效的 $O(n \log n)$ 级数论变换（NTT）；
2. 伪随机矩阵展开的对称密码开销：SCloud+ 在密钥生成与封装过程中，需要通过 AES 算法实时展开极其庞大的伪随机系数矩阵；
3. 缺少硬件 AES-NI 加速回退：ESP32-S3 核心并未配备类似 x86 AES-NI 的专用指令集，通用 C 语言实现的 Gladman T-table AES 在 Xtensa 核心上需要消耗大量的移位与查表周期，导致矩阵展开耗费了绝大部分时钟周期。

相比之下，Aigis-enc Mode 1 表现出与 ML-KEM-512 高度接近的卓越性能（KeyGen 5.16ms，Encaps 8.29ms），且公钥尺寸进一步压缩至 736 字节，充分证明了基于结构化模块格的 PQC 方案在微控制器端的绝对计算效率优势。

8. 片上物理真随机数（TRNG）与高熵注入工程

所有后量子公钥密码方案的安全性基石均无条件建立在初始随机熵源的不可预测性之上。在格密码的私钥抽样（如高斯分布或居中二项分布 CBD 采样）以及 SLH-DSA 的随机化盐值生成中，任何熵源退化或周期性预测都将直接导致私钥被全面攻破。

8.1 嵌入式环境下的 POSIX 陷阱与硬件 TRNG 适配

在开源 PQC 移植过程中，最常见的代码陷阱是直接沿用基于 POSIX 标准的通用随机数读取逻辑：

/* 错误代码示范：引发嵌入式崩溃的 POSIX 调用 */
int randombytes(uint8_t *obuf, size_t len) {
    int fd = open("/dev/urandom", O_RDONLY);
    if (fd < 0) abort(); // ESP-IDF VFS 中无此字符设备，直接触发 abort() 崩溃！
    read(fd, obuf, len);
    close(fd);
    return 0;
}

在 ESP32-S3 裸机系统上，VFS 并未挂载 /dev/urandom 节点，open() 永远返回 -1，进而触发 abort() was called at PC 0x4201b877。

正确的物理熵源接入方式： 必须利用 ESP-IDF 提供的片上物理真随机数驱动接口 esp_fill_random()：

/* pqc_common/randombytes.c 正确实现 */
#include "esp_system.h"
#include "esp_random.h"

int randombytes(uint8_t *obuf, size_t len) {
#if defined(ESP_PLATFORM)
    esp_fill_random(obuf, len);
    return 0;
#else
    // 通用平台 POSIX 回退实现
    ...
#endif
}

8.2 物理熵源采样机理与 NIST SP 800-90B/C 合规

ESP32-S3 片上集成的 TRNG 物理熵源通过采集内部 Wi-Fi 与蓝牙射频模拟前端的热噪声（Thermal Noise），经由高速 SAR ADC 进行实时量化。在射频子系统处于使能状态下，该熵源能够提供符合 NIST SP 800-90B 与国密 GM/T 0062 标准的连续高熵数据。

为了客观评估片上物理真随机数发生器的统计质量，我们连续采集了 100MB 原始 ADC 熵流，并通过 NIST SP 800-22 标准测试套件（包括单比特频数检验、块内频数检验、游程检验、最长 1 游程检验、二阶矩阵秩检验、离散傅里叶变换频谱检验、非重叠模板匹配检验、重叠模板匹配检验、通用统计检验、近似熵检验、累加和检验与序列检验共 15 项核心测试指标）进行了全项统计检验。在显著性水平 lpha = 0.01 条件下，所有 15 项检验的 $p\mathrm{-value}$ 均大于 0.01 且样本通过率达到 98.8% 以上，证实片上物理噪声源具备高度的统计独立性与不可预测性。

在正微光电与母公司正则量子的整体量子安全体系中，针对需要极高安全等级的局端根密钥注入场景，我们通过自主研发的 1Gbps 物理速率量子随机数发生器（QRNG）量产板卡，在产线固件烧录阶段将高品质的真量子物理熵注入安全芯片内部的受保护安全存储区（eFuse / Secure Storage），从而在设备出厂初始态即奠定坚不可摧的熵源底座。配合片上硬件真随机数形成“静态根密钥真量子注入 + 动态会话密钥片上物理采样”的双重熵保障体系。

9. Keccak-f1600 状态置换与对称哈希微架构优化

在所有的后量子密码标准中，Keccak-f1600 置换及其衍生的 SHA-3、SHAKE-128 与 SHAKE-256 可扩展输出函数（XOF）占据了超过 40% 至 65% 的执行时钟周期。无论是 ML-KEM 的矩阵种子扩展、ML-DSA 的多项式掩码采样，还是 SLH-DSA 的巨型哈希树遍历，Keccak 都是不可或缺的底层算力支柱。

9.1 64 位 Keccak 状态在 32 位 Xtensa 核心上的指令展开

Keccak-f1600 状态由 25 个 64 位字（Lanes）组成，排布为 $5 imes 5$ 的三维状态矩阵。然而，Xtensa LX7 是纯 32 位架构，每个 64 位字必须拆分为高 32 位与低 32 位两个通用寄存器（high, low）。

在标准 Keccak 的 $heta$（Theta）、$ho$（Rho）与 $\pi$（Pi）步骤中，包含了大量的 64 位循环左移（Circular Rotate, ROTL64）操作。在 32 位处理器上，朴素的 64 位循环移位需要执行两次 32 位逻辑移位、两次反向移位与两次按位或运算：

/* 朴素 32 位模拟 64 位循环左移 */
static inline uint64_t rotl64_naive(uint64_t x, unsigned int c) {
    return (x << c) | (x >> (64 - c));
}

在 Xtensa 汇编层面，这一操作会膨胀为 8 至 10 条基础算术指令。为此，我们利用 Xtensa LX7 提供的专用移位漏斗指令 src（Shift Right Combined）重构了 32 位双字移位流水线：

• 当移位量 $c < 32$ 时，利用 src 指令直接在单周期内完成跨寄存器高低位的位抽取：

$$\mathrm{low}' = \mathrm{SRC}(x_{\mathrm{low}}, x_{\mathrm{high}}, 32-c)$$ $$\mathrm{high}' = \mathrm{SRC}(x_{\mathrm{high}}, x_{\mathrm{low}}, 32-c)$$

• 当移位量 $c \ge 32$ 时，先交换高低寄存器，再执行 $c - 32$ 位的漏斗抽取。

9.2 状态置换原位循环展开与寄存器驻留

在执行 Keccak-f1600 的 24 轮置换迭代时，频繁的内存读写是导致吞吐下降的第二大瓶颈。ESP32-S3 的 Xtensa LX7 提供了 32 个通用寄存器，我们利用寄存器窗口扩展机制，将 Keccak 状态中最活跃的 10 个 64 位字（占 20 个 32 位物理寄存器）常驻于 CPU 寄存器堆中，消除了循环内部对 SRAM 栈的重复 L32I / S32I 访存操作。实测显示，单次 Keccak-f1600 置换耗时从 4 120 个周期下降至 2 380 个周期，整体提速达 42.2%。

10. 嵌入式抗侧信道防护：掩码方案与故障注入防御

在物联网与嵌入式物理部署环境中，微控制器通常置身于缺乏物理机房防护的边缘现场，攻击者能够通过直接接触芯片管脚或近场探针实施物理侧信道攻击（SCA）与故障注入攻击（Fault Injection Attacks, FIA）。如果后量子算法仅具备数学上的抗量子安全性而在物理实现上存在侧信道泄漏，整个系统的安全防线仍将彻底瓦解。

10.1 一阶布尔掩码与算术转换设计

在 ML-KEM 的私钥解密与 ML-DSA 的签名生成中，敏感私钥多项式的系数容易通过动态功耗轨迹（DPA）与电磁辐射（SEMA）发生泄漏。我们在底层模算术中引入了一阶布尔掩码（First-Order Boolean Masking）防护：

1. 随机掩码拆分：在私钥加载阶段，利用硬件 TRNG 生成真随机掩码多项式 $\mathbf{M} \in R_q$，将私钥 $\mathbf{s}$ 拆分为两份独立的共享份：

$$\mathbf{s}^{(0)} = \mathbf{s} \oplus \mathbf{M}, \quad \mathbf{s}^{(1)} = \mathbf{M}$$

2. 掩码数论变换：对两份共享份分别独立执行 NTT 变换，利用数论变换的线性叠加与加法同态性完成频域点乘；
3. 高阶算术到布尔转换（A2B / B2A）：在执行解封装阈值判决时，采用常数时间的 SecAdd 与 Goubin 转换算法，确保任何中间状态均与真实敏感数据在统计上相互独立，消除一阶功耗相关性；
4. 指令流水线乱序与功耗平坦化：在关键 Montgomery 乘法循环中插入微秒级伪操作与指令乱序，平滑物理功耗尖峰，实测将相关性功耗分析（CPA）所需的最小攻击轨迹数提升了 3 个数量级以上。

10.2 硬件故障注入防御与冗余校验

针对利用激光照射（Laser Fault Injection）或电压毛刺（Voltage Glitching）跳过 ML-DSA 范数检查判决指令的物理攻击，我们构建了多层控制流完整性与冗余执行防护机制：

• 双轨冗余判决（Dual-Rail Decision）：在拒绝采样范数检查中，由两套独立的寄存器分别执行高低位范围比对，使用互补掩码进行双重断言，任何单点位翻转均会导致断言失败；
• 控制流签名度量（Control Flow Integrity, CFI）：在关键函数入口、循环体与出口设置动态签名累加器，若指令因硬件跳变跳过中间步骤，累加器值将发生偏差并触发硬件断错中断；
• 签名后即时验证（Verify-after-Sign）：在 ML-DSA 签名生成完毕后，控制器在安全沙箱中自动调用公钥验签函数对签名进行二次自检，一旦检测到签名失效立即物理擦除私钥缓存并锁定安全模块。

11. FreeRTOS 多任务调度、内存池与栈高水位精细化管理

在双核嵌入式系统上运行后量子密码时，密码计算的瞬时高负载必须与系统的实时通信调度实现解耦。

11.1 双核对称多处理（SMP）任务亲和性配置

ESP-IDF 对 FreeRTOS 进行了深度 SMP 改造，支持两个 Xtensa LX7 核心共享同一任务就绪队列。为了消除密码运算对网络协议栈与外设调度的抖动干扰，我们实施了严格的核心隔离（Core Pinning）策略：

• Core 0（协议与 I/O 专有核）：绑定运行 Wi-Fi 驱动、LwIP TCP/IP 协议栈、MQTT 客户端以及系统定时器服务，保障毫秒级网络心跳与报文收发；
• Core 1（PQC 密集密码核）：通过 xTaskCreatePinnedToCore() 将后量子密码任务显式绑定至 Core 1 运行，使其独占 Core 1 的 240MHz 算力与 PIE 向量单元，完全消除多任务上下文频繁切换带来的 Cache 抖动。

/* PQC 任务核心绑定与栈分配 */
xTaskCreatePinnedToCore(
    pqc_worker_task,          // 任务入口函数
    "pqc_worker",             // 任务名称
    131072,                   // 分配 131KB 任务栈空间
    NULL,                     // 任务参数
    tskIDLE_PRIORITY + 2,     // 任务优先级
    &s_pqc_task_handle,       // 任务句柄
    1                         // 显式绑定至 Core 1
);

11.2 栈高水位监控与零堆分配（Zero-Heap）原则

为了彻底根除动态内存申请导致的堆内存碎片化（Heap Fragmentation）与内存耗尽（OOM）风险，我们制定了嵌入式 PQC 固件的两大铁律：

1. 全静态内存分配：算法内部所有多项式结构、中间计算缓冲区一律采用静态局部变量或预分配上下文，禁止在运行时调用 malloc() / free()；
2. 编译期与运行时双重栈水线断言：在固件中集成 uxTaskGetStackHighWaterMark() 周期性探针，确保在任何极端边界条件下，任务栈的剩余空间始终大于 32KB。实测表明，在优化后的 ML-DSA-44 与 ML-KEM-512 连续高压测试下，ESP32-S3 的栈高水位始终稳定在 86 120 字节 以上，展现出极致的系统稳健性。

12. 物联网后量子固件安全空中升级（PQC-OTA）架构

随着物联网终端在电网、轨道交通与工业控制领域的生命周期长达 10 至 15 年，设备必须具备在全生命周期内抵御后量子攻击的固件安全空中升级能力。

12.1 双区 A/B 分区差分升级流水线

针对 Flash 空间受限的嵌入式设备，我们构建了基于 ML-DSA-44 与 SLH-DSA-128s 混合签名的双区 A/B 分区 OTA 容灾架构：

1. 分区布局：片外 16MB SPI Flash 划分为 factory（出厂恢复区）、ota_0（当前运行区）与 ota_1（目标写入区）；
2. 流式差分接收与验签：设备通过 MQTT/HTTPS 通道接收差分固件包，GDMA 将数据分块写入目标分区，同时调用片上硬件 SHA-256 计算镜像全量哈希；
3. 后量子复合签名校验：固件末尾附带 2420 字节的 ML-DSA-44 签名与 7856 字节的 SLH-DSA 签名。系统优先执行耗时仅 15.2ms 的 ML-DSA-44 快速验签，若验证通过则将 OTA 状态寄存器标记为待生效；在安全等级要求极高的场景下，触发 SLH-DSA-128s 深度验签（51.9ms），达成双重算法数学保障；
4. 回滚保护与防版本降级：通过安全芯片内部的单调递增硬件计数器（Anti-Rollback Monotonic Counter），杜绝攻击者重放旧版本脆弱固件；
5. 掉电安全原子切换（Power-Loss Resilience）：在向引导加载程序（Bootloader）提交新固件生效标记时，采用双扇区原子序列号递增写入机制，即便在 Flash 写入中途遭遇突发断电，Bootloader 仍能平滑回滚至原有有效分区，彻底杜绝设备变砖风险。

13. 公司技术矩阵与多架构协同加速生态

正微光电（zwqtech.com，2025 年成立）承接母公司正则量子（北京）技术有限公司（2022 年成立）的核心安全业务，构建了涵盖量子物理真随机数、后量子密码算法库、抗量子硬件 IP 核及云密码服务平台的完整自主交付矩阵。

13.1 全栈异构算力加速成果

在后量子密码工程化落地领域，公司研发团队针对多种主流处理器架构展开了深入的底层微架构级指令优化，形成了跨平台的高效 PQC 算力加速生态：

• ARM 架构深度优化：针对 ARM Cortex-A7 等广泛应用于工业物联网与电力采集终端的处理器，利用 32 位 NEON 矢量引擎重构数论变换与 Montgomery 模乘管线，实现了 6.7 至 8.9 倍 的大幅性能加速，已成功落地于国家电网物联网试点项目；
• FPGA 硬件 IP 核交付：公司自主研发的高性能 PQC FPGA IP 核，在标准测试环境中顺利通过全部 193/193 组已知答案测试（KAT），涵盖 FIPS 203、FIPS 204 与 FIPS 205 全参数集，展现出极致的算法符合度与硬件可靠性；
• 高吞吐物理真随机数：研发并量产了基于量子真空涨落与相位噪声机理的 1Gbps 物理速率 QRNG 板卡，为大规模密码机与密钥管理系统（KMS）提供全熵源保证；
• 核心知识产权布局：团队在后量子密码硬件加速、抗侧信道防护、量子随机数实时后处理等核心技术方向上已累计获得 13 项授权专利，筑牢了深厚的底层技术壁垒。

通过将经过实机严苛验证的微控制器轻量级 PQC 固件、Cortex-A/M 优化库、FPGA 高速协处理器与局端量子密码机无缝融合，正微光电为智能电网、轨道交通、智慧金融及关基设施提供了端到端、利旧现有设施且面向后量子时代的平滑迁移全景方案。

14. 嵌入式多核心协同与功耗分析

在工业物联网与移动边缘计算节点中，微控制器的能量消耗与瞬时峰值功耗是决定系统能否长期稳定运行的关键物理指标。后量子密码算法的高强度矩阵运算与哈希迭代相比传统椭圆曲线密码（ECC）引入了显著更高的动态功耗。

14.1 动态功耗与电流瞬态响应

在 3.3V 供电电压与 240MHz 核心主频下，我们通过片外高精度电流探头配合示波器，对 ESP32-S3 在执行各类后量子密码运算时的电流瞬态波形进行了实测分析：

1. 基线待机电流：在 FreeRTOS 空闲状态且关闭 Wi-Fi/BT 射频时，系统平均工作电流为 28.5 mA；
2. ML-KEM-512 运算功耗：执行 KeyGen 与 Encaps 期间，双核动态电流上升至 68.2 mA ~ 72.4 mA，单次密钥协商流程消耗的总能量约为：

E_{\mathrm{kem}} = V imes I imes t = 3.3\,\mathrm{V} imes 70.3\,\mathrm{mA} imes 13.57\,\mathrm{ms} pprox 3.15\,\mathrm{mJ}

3. ML-DSA-44 签名功耗：由于包含高频拒绝采样与 SHAKE-128 流式生成，平均动态电流达到 75.1 mA，单次签名平均能量消耗约为：

E_{\mathrm{sign}} = 3.3\,\mathrm{V} imes 75.1\,\mathrm{mA} imes 51.24\,\mathrm{ms} pprox 12.70\,\mathrm{mJ}

4. SLH-DSA-128s 功耗特征：由于签名计算长达 36.4 秒，全速运算下的持续功耗会导致芯片表面结温上升 12°C 至 15°C。通过前述的非阻塞让出调度（在每层 XMSS 迭代后插入 10ms 休眠），平均工作电流显著下降至 46.8 mA，有效抑制了温升过高与热失控风险。

14.2 动态电压与频率调节（DVFS）策略

为了在电池供电的低功耗物联网传感器上延长续航，我们构建了基于工作模式自适应切换的动态调频机制：

• 常规报文采集态：CPU 主频下调至 80MHz，功耗降至 18 mA，维持传感器数据采样与周期性心跳；
• PQC 握手与固件验签态：通过电源管理接口 esp_pm_lock_acquire() 动态升频至 240MHz，在最短时间内完成 ML-KEM 或 ML-DSA 运算并迅速回落，实现“突发计算-深度休眠”（Race-to-Sleep）的极致能效比。

15. 总结与嵌入式后量子迁移工程指南

本篇工程报告详尽记录了在乐鑫 ESP32-S3 双核 Xtensa LX7 微控制器上部署 NIST FIPS 203/204/205 与国密 PQC 算法的完整技术路径与实测数据。基于第一线研发与实机调试经验，我们为广大嵌入式安全工程师总结出以下 7 条黄金落地法则：

1. 栈空间硬性扩充：严禁在默认 32KB 栈空间下运行标准 ML-DSA 或 SLH-DSA 代码，必须在 sdkconfig 中将主任务栈显式提升至 131072（131KB）以上，并用 uxTaskGetStackHighWaterMark() 持续监测；
2. 坚决采用流式矩阵展开：在 ML-DSA 实现中全面弃用 polyvecl mat[4] 局部矩阵声明，改用原位流式 ExpandA 方案，直接削减 16KB 静态栈开销；
3. 命名空间前缀强制隔离：在多算法集成的工程中，必须在头文件层级对 ntt、pack_pk、poly_reduce 等通用符号添加独立前缀宏，杜绝链接阶段扁平命名空间的重复定义冲突；
4. 直连片上物理真随机数：彻底剔除 POSIX /dev/urandom 依赖，无条件将 randombytes() 接口绑定至 esp_fill_random() 物理射频热噪声熵源；
5. 长耗时操作防看门狗饥饿：对于 SLH-DSA 签名等长达数十秒的密集计算，必须拆分为独立任务并按层主动让出 CPU（vTaskDelay），规避 Task-WDT 误复位；
6. 双核计算与通信物理隔离：在 FreeRTOS 中将网络协议栈固定于 Core 0，PQC 密码密集核固定于 Core 1，确保系统实时响应不受密码突发计算影响；
7. 全流程零堆内存申请：全篇杜绝 malloc() 动态内存申请，采用全静态缓冲区消除堆碎片隐患，确保嵌入式系统在十数年运行周期内的零故障稳定性。

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参考文献

1. National Institute of Standards and Technology. FIPS 203: Module-Lattice-Based Key-Encapsulation Mechanism Standard. 2024. Available: https://csrc.nist.gov/pubs/fips/203/final
2. National Institute of Standards and Technology. FIPS 204: Module-Lattice-Based Digital Signature Standard. 2024. Available: https://csrc.nist.gov/pubs/fips/204/final
3. National Institute of Standards and Technology. FIPS 205: Stateless Hash-Based Digital Signature Standard. 2024. Available: https://csrc.nist.gov/pubs/fips/205/final
4. National Institute of Standards and Technology. Recommendation for Stateful Hash-Based Signature Schemes. NIST SP 800-208. 2020. Available: https://csrc.nist.gov/pubs/sp/800/208/final
5. Espressif Systems. ESP32-S3 Technical Reference Manual. 2024. Available: https://www.espressif.com/sites/default/files/documentation/esp32-s3_technical_reference_manual_en.pdf
6. Espressif Systems. ESP32-S3 Series Datasheet. 2024. Available: https://www.espressif.com/sites/default/files/documentation/esp32-s3_datasheet_en.pdf
7. D. J. Bernstein, et al. Dilithium for Memory Constrained Devices. IACR Cryptol. ePrint Arch., 2022/323. 2022. Available: https://eprint.iacr.org/2022/323.pdf
8. M. J. Kannwischer, et al. Accelerating SLH-DSA on Microcontrollers. IACR Cryptol. ePrint Arch., 2024/367. 2024. Available: https://eprint.iacr.org/2024/367.pdf
9. Open Quantum Safe. liboqs ML-DSA Implementation Specification. 2024. Available: https://openquantumsafe.org/liboqs/algorithms/sig/ml-dsa.html
10. Internet Engineering Task Force. Multiple Key Encapsulation Mechanisms in Internet Key Exchange Protocol Version 2 (IKEv2). RFC 9370. 2023. Available: https://www.rfc-editor.org/rfc/rfc9370.html